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通过对北斗导航电文BCH纠错编译码方式的深入理解和研究,提出了一种基于并行数据处理的BCH译码器的设计方案.该方案利用FPGA对BCH电文进行并行处理,在一个时钟周期内实现电文译码,提高了BCH解码模块的译码效率;同时给出了系统各个模块的Modelsim仿真结果与分析,验证了设计的可行性.本设计对提高接收机的基带数据处理性能有一定的参考和指导意义.
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微型机与应用
ISSN： 1674-7720
CN： 11-5881/TP
Year： 2016
Issue： 1
Volume： 35
Page： 71-73,80
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