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[期刊论文]

H.264/AVC解码端帧内预测的设计与实现

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author:

胡林锋 (胡林锋.) [1] | 于映 (于映.) [2]

Indexed by:

CQVIP CSCD

Abstract:

本文根据H.264/AVC标准中帧内预测的特点,分析了帧内预测的所有预测模式.提出了一种适合于帧内预测的硬件电路结构,有效地减少了电路面积,并提高了解码的性能.该帧内预测硬件电路,使用Verilog HDL硬件描述语言编写代码,同时进行了仿真和验证,并在0.18um CMOS工艺库下进行综合,最高频率能够达到142 MHz.

Keyword:

H.264 帧内预测 并行化 流水线

Community:

  • [ 1 ] [胡林锋]福建福州大学物理与信息工程学院,350002
  • [ 2 ] [于映]江苏南京邮电大学通信工程学院,210003

Reprint 's Address:

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Source :

微计算机信息

ISSN: 1008-0570

CN: 14-1128/TP

Year: 2009

Issue: 9

Volume: 25

Page: 284-286

Cited Count:

WoS CC Cited Count:

30 Days PV: 0

Online/Total:48/10134863
Address:FZU Library(No.2 Xuyuan Road, Fuzhou, Fujian, PRC Post Code:350116) Contact Us:0591-22865326
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