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Viterbi算法是卷积码的一种最大似然译码.文中介绍了(2,1,9)的Viterbi译码器的FPGA一种实现方案,其中ACS运算采用两个基四蝶形运算、幸存路径采用单指针进行回溯、路径度量存储为乒乓结构,电路经过综合后输出速率最高能达到2.3Mbps.
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福建电脑
ISSN： 1673-2782
CN： 35-1115/TP
Year： 2009
Issue： 8
Volume： 25
Page： 95-96
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